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Di it l
Corso di Laurea triennale in
Ingegneria dellInformazione
A.A. 2014/2015
Il transistor MOSFET
Sommario
Struttura di un MOSFET
Principio di funzionamento (semplificato)
Caratteristica tensione-corrente
T i
Tensione
di soglia
li
Struttura di un MOSFET
Sezione
Vista dallalto
GATE
SOURCE
DRAIN
Simbolo circuitale
S
D
G
D
G
MOSFET a canale n
o nMOS
tipo n+
tipo n+
tipo p
S
B
S
D
G
D
G
MOSFET a canale p
o pMOS
tipo p+
tipo p+
tipo n
S
B
VDS
VGS=0V
0V
p+-Si
Si
n+-Si
Si
D
n+-Si
Si
p-Si
Regione di carica spaziale
p+-Si
Si
n+-Si
Si
VDS
D
n+-Si
Si
p-Si
Regione di carica spaziale aumenta di spessore
(drogante ionizzato, no portatori liberi)
VGS > VT
p+-Si
Si
n+-Si
Si
VDS
n+-Si
Si
p-Si
V 2
W
I DS = kn (VGS VT )VDS DS
L
2
kn = nCOX
Funzionamento: saturazione
Esempio MOSFET a canale n
VGS
- +
VGS > VT
p+-Si
Si
n+-Si
Si
VDS
D
n+-Si
Si
p-Si
1 W
2
I DS = I DSAT = kn (VGS VT )
2
L
VGS =2.5V
IDS [A]
500
Lineare
Saturazione
400
VDS = VGS - VT
300
VGS =2.0V
2.0V
200
VGS =1.5V
100
VGS =1.0V
0.5
I DS
1.5
VDS [V]
2.5
1 W
I DS = kn VDS 2
2
L
VGS < VT
0
W
V 2
= kn (VGS VT )VDS DS VGS > VT e VDS < VGS VT
2
L
1 W
kn (VGS VT )2
VGS > VT e VDS > VGS VT
L
2
cut off
lineare
saturazione
10
VSB
- +
p+-Si
n+-Si
D
n+-Si
p-Si
Tensione di soglia:
VT = VT 0 +
VSB + 2F
2F
e F sono parametri che dipendono dal drogaggio e dalla capacit dellossido di gate
Questo ffenomeno non visibile
Q
i ibil dei
d i MOSFET di
discretii perch
h il source e il
substrato sono cortocircuitati internamente
Andrea Cester, Elettronica Digitale - Laurea in Ingegneria dell'Informazione
11
VT = VT 0 +
VSB + 2F
2F
2qN
N A Si
Cox
F =
kT N A
ln
q
ni
0.9
0.85
0.8
0.75
VT [V]
0.7
0.65
0.6
0.55
0.5
0 45
0.45
0.4
0
0.5
1.5
2.5
VSB [V]
12
p+-Si
n+-Si
D
n+-Si
nMOS
VB VS < 0 sempre
VB VD < 0 sempre
VB < VS, VD qualunque sia VS e VD
VB deve essere la tensione
pi bassa del circuito!
p-Si
pMOS
n+-Si
Si
p+-Si
Si
D
p+-Si
Si
n-Si
VS VB < 0 sempre
VD VB < 0 sempre
VB > VS, VD qualunque
l
sia
i VS e VD
VB deve essere la tensione
pi alta del circuito!
13
14
VGS
VGD = VT
D
Il punto
t di pinch-off
i h ff all drain
d i
VGS
VGD < VT
D
Il punto
t di pinch-off
i h ff sii
allontana dal drain
x
Equivale a ridurre la
lunghezza di canale da L a L
15
Modulazione della
lunghezza di canale
I DS ~
1 W
2
kn
(VGS VT )
2 L'
L ' L (1 VDS )
1
W
1 W
2
2
I DS kn
(VGS VT ) kn (VGS VT ) (1 + VDS )
2 L (1 VDS )
2
L
IDS
I DSAT (1 + VDS )
I DSAT = costante
VDS
16
EC = ~1.5V/m
E [V/cm]
Qual leffetto sulla relazione I-V ?
EMEDIO = VDS/L
IDS
VDS
Saturazione prematura della corrente
VDSAT
VGS-VT
17
VGS2-VT
VDS
VGS VT bassa la corrente di saturazione quella prevista dal modello a canale lungo
VGS VT alta la corrente di saturazione inferiore a q
quella p
prevista dal modello a canale lungo
g
18
VDS = VDSAT
VDSAT = VGS - VT
VDS
VDSAT
I DS
VGS-VT
VGS < VT
0
=
2
k W V V V VMIN 1 + V
(
)
T
MIN
n DS ) VGS > VT
GS
(
n
2
L
VT = VT 0 +
cut off
VMIN = VDS lineare
VMIN = VDSAT saturazione di velocit
VMIN = VGS - VT saturazione
t
i
VSB + 2F
2F
19
2.5
x 10
-4
VDS=VDSAT
2
Velocity
Saturated
ID (A)
1.5
Linear
1
VDSAT=VGT
0.5
VDS=VGT
0
0.5
Saturated
1
1.5
2.5
VDS (V)
20
Corrente di saturazione
IDSAT
Canale lungo
(quadratico)
I DSAT
1 W
2
kn
VGS VT < VDSAT
(VGS VT )
2
L
=
kn W VDSAT VGS VT VDSAT VGS VT > VDSAT
L
2
Canale corto
(lineare)
0
05
0.5
15
1.5
25
2.5
21
Transistor pMOS
Modello del MOSFET a canale corto
IDS
Adottiamo:
VDS = VGS-VT
VDS = VDSAT
k p = pCOX > 0
>0
p < 0
VDS
I DS
VGS > VT
0
=
2
k W V V V VMIN 1 + V
(
)
p
GS
T
MIN
p DS ) VGS < VT
2
L
VT = VT 0
VBS + 2F
cut off
VMIN = VDS lineare
VMIN = VDSAT saturazione di velocit
VMIN = VGS - VT saturazione
2F
22
substrato a 0V
S
IDS
substrato a VDD
k p = pCOX > 0
kn = nCOX > 0
p < 0
p >0
n > 0
n > 0
I DS = 0
OFF
ON
V 2
MIN (1 + nVDS )
2
W
I DS = kn n (VGS VTn )VMIN
Ln
VMIN = min (VDS ,VDSATn ,VGS VTn )
VTn = VTn 0 + n
IDS
VSB + 2Fn
2Fn
I DS = 0
OFF
ON
Wp
VMIN 2
= k p
(VGS VTp )VMIN
(1 + pVDS )
Lp
2
VTp = VTp 0 p
(V
BS
+ 2Fp
2Fp
)
23
24
VGS
+
VGS > VTn
Rn
VGS
+
S
Rp
25
VDD
ON
S
Rn =
Rn
S
VDS
V 2
W
kn (VGS VT )VMIN MIN (1 + nVDS )
L
2
26
VDS
2 DD
Rn =
dVDS
VGS = VDD
VDD/2
Rn =
3 VDD
4 I DSAT
1 VDD
9
VDS
VDD
I DSAT
1 W
2
kn
VDD VT < VDSAT
(VDD VT )
2
L
=
kn W VDSAT VDD VT VDSAT VDD VT > VDSAT
2
27
Rn
Rp
S
S
VGS = VDD
Rn =
I DSATn =
D
D
D
3 VDD 7
1 nVDD
4 I DSATn 9
VGS = VDD
Rp =
n > 0
1 Wn
2
kn
(VDD VTn ) se VDD VTn < VDSAT
2
Ln
W
V
S
3 VDD 7
1 + pVDD
4 I DSATp 9
p < 0
2
1 W
I DSATp = k p p ( VDD VTp ) se VDD VTp > VDSATp
2
Lp
I DSATp = k p
Wp
= 0.4
|2F| = 0.7
VDSATn = 0.63V
kn = 115A/V2
n = 0.06 V-1
VDSATp = -1V
kp = 30A/V2
p = -0.1 V-1
28
I DSATp = k p
Wp
VDSATp
Lp
2
Definiamo:
VDSATpp
Wn
Ln
Zp =
I DSATn = Z n I DSATn 0
Rn =
1 3 VDD 7
Rn 0
1 nVDD =
Z n 4 I DSATn 0 9
Zn
I DSATp = Z p I DSATp 0
Rp =
1 3 VDD 7
Rp0
1 + pVDD =
Z p 4 I DSATp 0 9
Zp
Wp
Lp
= fattore di forma
Rn0 = 13k
Rp0 = 29k
29
30
Cgs0
Cgd0
Cgc
tOX
source
drain
Csb
xD
xD
LD
source
Cdb
substrato
gate
LD
drain
31
xj
W
LD
LD
32
Csw W
tOX
Cox xDW =
0 ox
tox
xDW
xD
CGS 0 = Csw W +
CGD 0 = Csw W +
0 ox
0 ox
tox
tox
33
Capacit gate-canale
OFF
lineare
saturazione
VDS = 0V
ch
gd
VGS = VDD
Cch
CoxWL
1
CoxWL
2
CoxWL
Cch
C gsch
1
CoxWL
2
ch
gs
ch
C gd
C gb
0V
VT
VGS
VDD
2
CoxWL
3
0V
VDS
VGS VT
34
Capacit gate-canale
OFF
lineare
saturazione
ch
C gb
= Cch = CoxWL
1
1
C gsch = Cch = CoxWL
2
2
2
Cgsch = Cch = CoxWL
3
1
1
ch
C gd
= Cch = CoxWL
2
2
ch
C gd
=0
35
Capacit in cut-off
G
Cgs
Cgd
Cgb
Csb
Cdb
B
C gs = CGS 0 W
Cgd = CGD0 W
Cgb = Cox LW
Csb = C j 0 LDW + C jsw0 (W + 2 LD ) = ( C j 0 LD + C jsw0 )W + C jsw 0 2 LD
Cdb = C j 0 LDW + C jsw0 (W + 2 LD ) = ( C j 0 LD + C jsw0 )W + C jsw0 2 LD
Andrea Cester, Elettronica Digitale - Laurea in Ingegneria dell'Informazione
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Capacit in lineare
G
Cgs
Cgd
Cgb
Csb
Cdb
B
1
1
1
1
Cgb = 0
Csb = ( C j 0 LD + C jsw0 )W + C jsw0 2 LD
Cdb = ( C j 0 LD + C jsw0 )W + C jsw0 2 LD
Andrea Cester, Elettronica Digitale - Laurea in Ingegneria dell'Informazione
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Capacit in saturazione
G
Cgs
Cgd
Cgb
Csb
Cdb
B
2
2
Cgd = CGD0 W
Cgb = 0
Csb = ( C j 0 LD + C jsw0 )W + C jsw0 2 LD
Cdb = ( C j 0 LD + C jsw0 )W + C jsw0 2 LD
Andrea Cester, Elettronica Digitale - Laurea in Ingegneria dell'Informazione
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source-subtrato e drain-substrato
Csb = ( C j 0 LD + C jsw0 )W + C jsw0 2 LD
Csb Csb 0W
se
Cdb Cdb 0W
39
CG
S
CS
CD
40
Modello semplificato RC
CGD
Rn
G
D
CDB
CGS
G
S
S
CSB
D
Rn
G
CG
D
CD
41