Ingegneria Informatica

ELETTRONICA APPLICATA

De2 – ESERCIZI PARTE D.2

» Sistemi di conversione
» Errore complessivo
» ENOB
» Esempi di scritto

03/05/19 - 1 ElapDe2 - 2014 DDC

 De2: Esercizi su DAC e ADC

• De2.1 Sistema di acquisizione - A

• De2.2 Sistema di acquisizione - B

• De2.3 Calcolo ENOB - A

• De2.4 Calcolo ENOB – B

• De2.5 Esempio da prova scritta

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 Es. De2.1: sistema di acquisizione - A

1. Tracciare lo schema a blocchi di un sistema di

acquisizione A/D a 4 canali con:
1. Segnali di ingresso: unipolare da 1 a 2 V, con banda 0-15
kHz.
2. Convertitore A/D con ingresso 0-5V e Tc = 1μs.
3. S/H con tempo di acquisizione Ta = 700 ns

2. Per l’amplificatore di condizionamento:

1. Indicare le specifiche
2. Tracciare uno schema dell’amplificatore
3. Indicare i parametri che determinano i valori delle resistenze
utilizzate nell’amplificatore di condizionamento

03/05/19 - 3 ElapDe2 - 2014 DDC

 Es. De2.2: sistema di acquisizione - B

1. Per il sistema dell’esercizio De2.1:

1. Determinare il campo di cadenze di campionamento
utilizzabili
2. Indicare le caratteristiche del filtro di ingresso per un
rapporto segnale/rumore di aliasing SNRa di almeno 60 dB
3. Indicare il massimo jitter di apertura (Tjamax) per ottenere
un errore dovuto al solo jitter di apertura Eja < 0,1%
4. Indicare il numero di bit richiesto per ottenere un errore di
quantizzazione Eq pari all’errore di aliasing.

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 Richiami su SNR totale ed ENOB

• SNRtotale dipende dalla somma di vari termini:

– Quantizzazione , aliasing, jitter di apertura S/H, …
– Errori della catena di condizionamento (offset, guadagno)
– - ….

• Errore totale:
– Somma di termini
statisticamente
indipendenti (Ai)

• Ricavabile da SNRtot:
– ENOB = (SNRtot -1,76)/6 = SNRtot/6-0,3

• Numero effettivo di bit realmente significativi

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 Esercizio De2.3: calcolo ENOB - A

1. Per il sistema dell’esercizio De2.2, valutare il

rapporto segnale/rumore totale (SNRT) e il numero
effettivo di bit (ENOB).
Valori specificati o già noti per i singoli errori:
• Rapporto segnale/rumore di aliasing SNRa = 60 dB
• Errore dovuto al solo jitter di apertura Eja < 0,1%
• Errore di quantizzazione Eq pari all’errore di aliasing.

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 • Con N = 9 bit, SNRq = 6N+1,76 = 55,76 dB
• Con Eja = Eq, e’ come se si perdesse un bit, quindi
• SNRqja = 55,76 – 6 = 49,76 dB
• Dal momento che SNRqja << SNRa possiamo dire
che SNRtot <~ SNRqja = 49,76 dB
• Verifica:
• (-SNRtot )dB= 20 log10 (10^(-SNRqja/20) + 10^(-
SNRa/20)) = - 47.4 dB
• SNRtot = 47.4 dB

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 Esercizio De2.4: calcolo ENOB - B

1. Valutare il rapporto S/N totale (SNRT) e il numero

effettivo di bit (ENOB) per un sistema con:
1. ADC su 12 bit
2. Segnale sinusoidale 100 kHz; S/H con jitter 10 ns
3. Rumore di aliasing parti a 0,1% del fondo scala

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 • SNRq = 6N + 1.76 = 73.76 dB
• SNRja = -20 log10 ( Delta V / S ) = -20 log10 ( dV/dt *
tja / S) = -20 log10 ( 2pi F S/2 * tja / S) = -20 log10 ( pi
F * tja ) = 50 dB
• SNRa = -20 log10 (0.1/100) = 60 dB

• (-SNRtot )dB= 20 log10 (10^(-SNRq/20) + 10^(-

SNRja/20) + 10^(-SNRa/20)) = 47 dB

03/05/19 - 9 ElapDe2 - 2014 DDC

 Eserc. De2.5: esempio di scritto

• Un sistema di acquisizione A/D a 4 canali ha:

Vimax = 500mV, Vidc = 0, fmax = 100 KHz.
L’ADC ha una dinamica di ingresso da +5 a -5 V.
a. Tracciare lo schema a blocchi del sistema. Indicare le
specifiche dei singoli blocchi e il numero di bit richiesto
per ottenere una precisione globale almeno dello 0,1%.
b. Tracciare lo schema a blocchi di un convertitore A/D ad
approssimazioni successive, e indicare la cadenza di
clock richiesta per operare in questo sistema.
c. Tracciare uno schema di massima (almeno per 3 bit) del
convertitore D/A presente nell’A/D del punto b),
utilizzando una configurazione con rete a scala e
deviatori di corrente; indicare i vincoli sulla Ron degli
interruttori nel caso di rete a scala con R = 20 kΩ.

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 Eserc. De2.5-a: soluzione a)

a) Tracciare lo schema a blocchi del sistema. Indicare le specifiche

dei singoli blocchi e il num. di bit richiesto per una precisione
globale >= 0,1%.

Guadagno richiesto per l’amplificatore: Av = 5V/500mVp = 10

Assegnando metà dell’errore totale all’errore di quantizzazione:
Eq = 0,05% =1/2000 < 1/2^N; N = 11 (per N=10, Eq =+-1/2k).
Cadenza di campionamento Fsmin = Banda x 2 = 200 ks/s; con
Fs = 300ks/s (un canale), per 4 canali Fs = 300k x 4 = 1,2 Ms/s
Tacq + Tconv ≤ 1/1,2M = 833 ns (400 ns Tacq + 400 ns Tconv).
Il numero di poli P del filtro è legato alla cadenza di
campionamento e all’errore di aliasing Ea. Per Ea = 0,05%,
Fs=300 ks/s, alias a 200 kHz: attenuazione minima
1/0,0005 = 2000 (66 dB) da 100 a 200 kHz (1 ottava).
Un polo attenua 6 dB/ottava; servono: P = 66/6 = 11 poli.

03/05/19 - 11 ElapDe2 - 2014 DDC

 Eserc. De2.5-b: soluzione b)

b) Tracciare lo schema a blocchi di un convertitore A/D ad

approssimazioni successive, e indicare la cadenza di
clock richiesta per operare in questo sistema.

Per operare a 1,2 Ms/s mantenendo la scelta del punto a)

(Tconv = 400 ns) la cadenza di clock minima è:
Fck = (1/400ns) x 11 = = 27,5 MHz

È anche possibile usare configurazioni a residui multibit (più

complesse), con cadenza di clock più bassa.
Schema a blocchi nel lucido D3 – 31

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 Eserc. De2.5-c: soluzione c)

c)Tracciare uno schema di massima (almeno per 3 bit) del

convertitore D/A presente nell’A/D del punto b), utilizzando
una configurazione con rete a scala e deviatori di corrente;
indicare i vincoli sulla Ron degli interruttori nel caso di rete
a scala con R = 20 kohm.

Rete a scala con deviatori di corrente (4 bit) da lucido D2-42.

Assegnando metà dell’errore totale (0,05 % /2) alla Ron
dell’interruttore sul ramo MSB, si ottiene la condizione:
Ron < (0,05 % /2) 2R = 0,05 % R:
Ron < R 0,05/100 = 0,05 x 200 = 10 Ω
Il circuito deve includere un AO per trasformare la corrente in
tensione (non indicato nello schema)

03/05/19 - 13 ElapDe2 - 2014 DDC