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Claudio CANCELLI
(www.claudiocancelli.it)
INDICE
Unità di Lavoro x.1 – Introduzione Prerequisiti – Ottima conoscenza dei circuiti combinatori
alle funzioni di manutenzione (Modulo B) e dei circuiti sequenziali (Modulo D)
Obiettivi di Teoria Fondamentali Obiettivi di Laboratorio Fondamentali
CnT1-x.1.1 – Conoscere il concetto di Non previsti
servizio offerto da un sistema
CnT2-X.1.2 – Conoscere e comprendere il Obiettivi di Laboratorio Opzionali
significato di affidabilità, disponibilità, Non previsti
guasto ed errore
CnT3-X.1.3 – Comprendere le modalità di
rilevazione degli errori e di trattamento
del guasto
CnT4-X.1.4 – Introdurre il concetto di
manutenzione
Unità di Lavoro x.2 – La simulazione Prerequisiti – Unità di Lavoro x.1 – – Introduzione alle
e la realizzazione funzioni di manutenzione
Obiettivi di Teoria Fondamentali Obiettivi di Laboratorio Fondamentali
AbT1–x.2.1 – saper progettare l’hardware AbL1–x.2.3 – progetto HW e verifica
di controllo degli errori sul bus dati AbL2–x.2.4 – progetto SW e verifica
AbT2–x.2.2 – saper implementare una Obiettivi di Laboratorio Opzionali
routine scritta con un linguaggio di alto Non previsti
livello
Obiettivi di Teoria Opzionali
CnT3-X.2.3 - Programmare un
microcontrollore con la routine scritta in
x.2.2
Corrispondenze tra obiettivi e
verifiche
Da definire
Modalità di verifica, recupero ed
approfondimento
Da definire
SVILUPPO DELL’UNITA’ DI LAVORO x.1
CnT1 – x.1.1
Comprendere il concetto di servizio offerto da un sistema
Introduzione
Poniamoci le seguenti domande e cerchiamo di fornire risposte inerenti gli aspetti
legati alla sicurezza, all’affidabilità ed alla necessità di disporre dei servizi offerti
dall’apparato/sistema/gestore.
Evitiamo la fatica di ricercare la definizione di sistema e cerchiamo di dare un
significato al termine richiamando i concetti che ci saranno utili per la nostra
trattazione.
Esempio 1) Cosa succede il PC con il quale A
lavoriamo/giochiamo/comunichiamo tutti i giorni si guasta? E
se a guastarsi è il chip di memoria del PC presente nell’ufficio
dell’amministratore delegato di una multinazionale, quali
sarebbero le conseguenze?
RISPOSTE
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B …………………………………………………………………………………………
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D
RISPOSTE
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Esempio 4) E cosa dire di un satellite che viene progettato per una vita media di 8-
10 anni? E’ così grave che si renda inutilizzabile dopo un anno di vita per la presenza di
condizioni non previste nell’orbita geostazionaria?
RISPOSTE
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E ………………………………………………………………
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RISPOSTE F
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Es. x.1.1) Ed ora come esercizio, in quali dei sistemi riportati in figura spendereste
dei quattrini per garantire l’eccellente funzionalità dell’elettronica presente in
ciascuno di essi?
H
G
CnT1 – x.1.2
Conoscere e comprendere il significato di affidabilità, disponibilità, guasto ed
errore
Definizioni e concetti
Prima di procedere è necessario che vengano chiariti alcuni significati di termini
abbastanza ricorrenti.
Es. x.1.2) Una rete dati è composta da 5 router; l’affidabilità R(t) di ciascun
apparato è uguale a 0,99 in un anno. Vuol dire che ciascun apparato
funziona correttamente per il 99% del tempo.
-λt
R(t) = e
Es. x.1.3) Calcolare l’affidabilità di un componente a 3000 ore se il tasso di guasto
è pari a:
λ = 8*10-5 h -1 R(t) = 0,787 equivale alla probabilità del 78,7%
che il componente funzioni in tale arco di tempo.
–nλt
RS(t) = e
… ed alla p
paattoollooggiiaa:
– Un guasto è attivo (active ) quando produce un errore. Un guasto attivo è o un
guasto interno che era in precedenza inattivo (dormant ) e che è stato attivato
dal processo di elaborazione, o un guasto esterno.
Es. x.1.4) Per quale motivo il sistema operativo di un processore presente in una
centrale di commutazione telefonica dovrebbe schedulare un programma
di diagnostica nei confronti della periferica che consente il load della
cassetta di back-up (programmi + data base), e non prevedere la
schedulazione del programma che diagnostica le linee d’abbonato.
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E poi l’altro problema: è giusto affidarsi completamente alle risposte fornite dal
calcolatore?
È la manifestazione
ERRORE (ERROR)
del guasto nel sistema
MALFUNZIONE È la manifestazione
C. Cancelli – Introduzione(FAILURE)
alle Funzioni di Manutenzione dell’erroreEd.
sul1.0 - Dicembre 2010
servizio
Information and Communication Technology – Modulo n. 2 Pag. 14
Testing
Qualità
Sovradimensionamento
Diagnostica
Debugging HW e SW
– Predizione di guasti (fault
forecasting): come stimare il numero, la frequenza di incidenza,
presente e futura, e le conseguenze dei guasti.
In definitiva:
Es. x.1.6) Una domanda per voi. Tutti i guasti che possono capitare in un sistema
controllato da un microprocessore, si possono prevedere? In un sistema
controllato da un μp quali sono i guasti secondo te che non si possono
prevedere?
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CnT1 – x.1.3
Comprendere le modalità di rilevazione degli errori e di trattamento del guasto
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CPU …………………………………………………………
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Soluzioni……………………………………………………………………………………………………………………………………………
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CPU
CPU ?
FROM μP
Operazione di
SCRITTURA
Buffer Buffer
TO μP
Operazione di
LETTURA
MUX
Es. x.1.8) Fate riferimento all’alimentazione della CPU. Con l’architettura precedente
c’è un grosso problema. Riguarda l’alimentazione. Come potrebbe essere superato?
La soluzione, in questo caso ve la fornisco io e la discutiamo assieme.
MEMORIA MEMORIA
‘A’ ‘B’
In assenza di guasti una CPU è attiva e l’altra è in stand-by. Le due memorie vengono
contemporaneamente sia scritte sia lette.
TRATTAMENTO DELL’ERRORE
Il trattamento dell’errore può essere eseguito per:
o compensarlo
Esempio x.1.9) Supponiamo che per un’operazione di scrittura la CPU ‘A’ acceda IN
memoria con il valore F0F4 sul bus dati. Unitamente a tale dato un ODD parity
generator sul byte basso (DPL) presente all’interno della CPU genera il valore 1 ed un
ODD parity generator sul byte alto (DPH) genera il valore 0. Il controllore di parità
presente nella scheda di memoria rileva 1 piuttosto che 0 sul bit DPH e genera un
interrrupt diretto al microprocessore tramite il Programmable Interrupt Controller.
CPU ‘A’ μP
INT
P.I.C.
DPL= 1
D.B. = F0F4
INTMA
MEMORIA ‘A’
Alarm Register
DPH ER
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USER PROGRAM
Istante in cui il
guasto provoca
l’errore DPH-ER INTERRUPT HANDLER
Il S.O. consente il
riconoscimento
dell’Interrupt
i
i+1
μP
Write Operation Read Operation
Loop-Back Register #1
Ora con una seconda operazione sempre nei confronti dello stesso registro scriviamo
FFFF; se in lettura il dato è ancora FFFF, possiamo concludere che la parte tra il
microprocessore e la zona circoscritta da tale registro è PERFETTAMENTE
FUNZIONALE.
μP
Write Operation Read Operation
Loop-Back Register #1
Ora nel caso in cui l’operazione che prevede la scrittura di FFFF sul bus dati porti
come risultato di lettura un valore F7FF, ne risulta che la funzione EX-OR è pari a
0800 e quindi il bit 11 è il risultato dell’anomalia.
μP
Write Operation Read Operation
Loop-Back Register #1
RICONFIGURAZIONE
Supponiamo che la CPU “A” sia attiva e che la CPU “B” sia in stand-by. Se la CPU “A”
rileva, durante l’accesso in memoria, un guasto nella MEMORIA “A”, una volta
MEMORIA MEMORIA
‘A’ ‘B’
Un altro esempio di guasto può riguardare la CPU “A” attiva. In tal caso la CPU “A”
informa la CPU “B” che cerca di riprendere il controllo della situazione corrente,
sempre che la CPU “A” sia stata nella condizione di memorizzare le informazioni
correnti (indirizzi, dati, etc..) prima di essere dichiarata fuori servizio. In tal caso la
CPU “B” riprende il programma esattamente dal punto di interruzione della CPU “A”.
Se ciò non dovesse essere possibile la CPU “B” riprende dal programma di boostrap
con una perdita di dati transitoria e parziale.
MEMORIA MEMORIA
‘A’ ‘B’
6. CONCLUSIONI
Con l’unità di lavoro x.1 sono stati messi in evidenza gli aspetti considerati
propedeutici per trattare con la successiva unità, x.2, un progetto Hardware o
Software relativo alla diagnostica di una unità sospetta guasta.
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c.cancelli@tiscali.it
o
claudio.cancelli1@istruzione.it
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