CIRCUTOS DIGITALES

CIRCUITOS SECUENCIALES
El biestable: conocido tambien como bscula es un
dispositivo capaz de permanecer en estado u otro
durante tiempo indefinido, para variar su salida es
necesario variar su entrada

Clasificacin:
Asncronos: solo tiene entradas de control.
Sncronos : posee una entrada adicional
reservada para la seal de reloj, la cual definir el
tipo de entrada del dispositivo.

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CIRCUITOS SECUENCIALES
POR NIVEL

SINCRONOS

POR FLANCO

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CIRCUITOS SECUENCIALES

MASTER SLAVE

POR FLANCO DISPARO POR FLANCO DE SUBIDA

DISPARO POR FLANCO DE BAJADA

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EL FLIP FLOP S-R

Dispositivo de almacenamiento temporal de dos estados

(alto y bajo), cuyas entradas principales, R y S, a las que
debe el nombre, permiten al ser activadas:
R: El borrado (reset en ingls), puesta a 0 nivel bajo de
la salida.
S: El grabado (set en ingls), puesta a 1 nivel alto de la
salida.
Si no se activa ninguna de las entradas, el biestable
memoriza el estado que posea tras la ltima operacin de
set o reset. Nunca deberan activarse ambas entradas a la
vez, pues no se podra determinar el estado en el que
queda la salida.

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EL FLIP FLOP S-R

En la tabla de verdad se
Muestran Los valores de
E salida

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EL FLIP FLOP S-R

DIAGRAMA DE TIEMPO
Como se observa en el diagrama
de tiempo existen dos zonas
claramente definidas.

La zona en AZUL define las

operaciones de SET y RESET y la
opcin 00, donde se puede
observar como se mantienen los
estados al valor anterior, POR
CADA PULSO DE RELOJ

La zona en ROJO define las

acciones cuando se dispara por
flanco de subida del reloj y la
entradas S es colocada a 1

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EL FLIP FLOP D
Este flip-flop muestra en la salida el valor colocado en la entrada, por
cada pulso de reloj. Ejemplo: si en D est un 1 cuando llegue la seal
de reloj Q = D

Modo de activacin de la seal de sincronizacin:

Activo por nivel (alto o bajo), tambin denominado registro o
cerrojo (latch en ingls).
Activo por flanco (de subida o de bajada).

La ecuacin caracterstica del biestable D que describe su

comportamiento es:

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 CIRCUTOS DIGITALES

EL FLIP FLOP D
CIRCUITO EN BLOQUE
Aqu se presenta el circuito
equivalente en compuertas.
La combinacin de la seal
de habilitacin y la entrada
D genera una salida igual a
la entrada. En el caso que el
habilitador se encuentra en
cero se comporta como
memoria no importa el valor
de entrada D, quedando el
ltimo estado que se
produjo

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 CIRCUTOS DIGITALES

EL FLIP FLOP D
ACTIVADO POR FLANCO

Como puede observarse en la tabla

de verdad, se producen las
condiciones de SET y RESET solo si
existe la seal de reloj.

Observese tambien que este

dispositivo esta basado en un flip-
flop S-R con la entrada R negada y
no independiente de la entrada S

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 CIRCUTOS DIGITALES

EL FLIP FLOP J-K

Dispositivo de almacenamiento
temporal de dos estados (alto y CIRCUITO EN BLOQUE
bajo), cuyas entradas
principales, J y K permiten el
grabado y borrado de las
salidas.
Posee una diferencia
fundamental respecto al flip-flop
S-R, pues permite la condicin 1
1 prohibida EN FLIP FLOP S-R
Las seales de entrada de PRE
(preset) y CLR(clear) pueden ser
empleadas para modificar la
salida si se mantienen
constantes. Esto dependera del
tipo de flip-flop

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EL FLIP FLOP J-K

CIRCUITO EN BLOQUE
Obseve que en la tabla de
verdad si la entrada de clock no
es una seal de reloj, sino
valores fijos (0 o 1), el flip
recuerda el ltimo estado
(memoriza el estado anterior)
mientras que si tiene seal de
reloj tendra un valor segn las
entradas J-K

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 CIRCUTOS DIGITALES

EL FLIP FLOP J-K

Obseve que en la tabla de
CIRCUITO EN BLOQUE
verdad si la entrada de clock la
seal de reloj se mantiene fija (0
o 1), el flip recuerda el ltimo
estado (memoriza el estado
anterior) mientras que si tiene
seal de reloj tendra un valor
segn las entradas J-K

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 CIRCUTOS DIGITALES

APLICACIONES DE LOS FLIP -FLOP

Registros de Desplazamiento
Este dispositivo desplaza la
informacin que se tiene en la
entrada por cada pulso de reloj,
de tal forma que la informacin
va entrando bit a bit y
mostrndose en forma total a la
salida. Este tipo de entrada y
salida simula una entrada serial y
salida paralelo. Este tipo de
dispositivo se puede implementar
con un Flip-flop tipo D pues es el
que posee una entrada y cambia
por cada pulso de reloj
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 CIRCUTOS DIGITALES

APLICACIONES DE LOS FLIP -FLOP

En la figura se presenta el
circuito equivalente de un
registro de desplazamiento o
registro de entrada Serie salida
en Paralelo.
El diagrama de Tiempo muestra
la secuencia de los datos de
entrada 0110.
El 74LS164, es un dispositivo de
este tipo, por cada flanco de
subida del clock se produce la
transicin
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 CIRCUTOS DIGITALES

APLICACIONES DE LOS FLIP -FLOP

En la figura se presenta el
circuito equivalente de un
registro de desplazamiento o
registro de entrada Serie salida
en Serie.
Aqu los datos se van
desplazando por cada pulso de
reloj y la secuencia serie se
obtiene en la ltima salida

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 CIRCUTOS DIGITALES

APLICACIONES DE LOS FLIP -FLOP

En la figura se presenta el
circuito equivalente de un
registro de desplazamiento
o registro de entrada
Paralelo salida en Serie.
Los datos son vistos en el
ltimo flip-flop

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 CIRCUTOS DIGITALES

APLICACIONES DE LOS FLIP -FLOP

En la figura se presenta el circuito equivalente de entrada Paralelo salida en
Paralelo, este circuito se combina con el serie-paralelo para mostrar los datos en
un puerto.

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 CIRCUTOS DIGITALES

CONTADORES
Son circuitos secuenciales
compuestos
fundamentalmente por
biestables, que en su diagrama
funcional, tienen una entrada
de reloj o sincronismo
Salida 1
Salida 2
Entrada de impulsos CONTADOR

Salida N

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CONTADOR SECUENCIAL

CONTADORES
DIAGRAMA DE TIEMPO DE UN CONTADOR
ASINCRONO DE 4 BITS
 CONTADOR ASINCRONO

La frecuencia mxima del reloj para un

contador es dada por:
1/f <= N(Tp) + Ts
N = nmero de etapas de flip-flops.
Tp= tiempo de propagacin de un flip-flop.
Ts = tiempo de compuerta, ancho del pulso
de la salida decodificada o de etapas de
flip-flops.
 CONTADOR ASINCRONO
MOD: El numero MOD siempre es igual al numero de
estados por los cuales pasa el contador en cada ciclo
completo antes que se recicle hacia su estado inicial. En el
circuito mostrado tenemos un contador de Diez estados (0-
9). Con lo que tenemos un MOD 10
DIAGRAMA DE TIEMPOS DE UN CONTADOR

CONTADOR ASINCRONO
Supongamos
una entrada de
8Hz. Indique la

DIVISOR DE FRECUENCIA
frecuencia de
Salida Q3
CONTADOR ASINCRONO 74LS293
CONTADOR ASINCRONO 74LS293
 CONTADOR SINCRONO

LSB
MSB

CONTADOR SINCRONO
 CONTADOR SINCRONO
Pasos para Analizar contadores Asncronos
Escribir las expresiones lgicas para cada una
de las expresiones de control de los FF
Realizar una tabla de estado PRESENTE/
estado SIGUIENTE
Estado Presente Entradas de Control Estado Siguiente
Xn.......Xo
Xn..Xo JnKn J3K3 J2K2 J1K1 JoKo
 CONTADOR SINCRONO
Ejemplo:
Obtener las
ecuacines
lgicas para
cada una de las
entradas de
control de los
FFs

J2 = A.B
J1 = A = K2 J0 = K0 = C
K2 = C
 CONTADOR SINCRONO
Estado Presente Entradas de Control Estado Siguiente
Q2Q1QO
Q2Q2Q0 J2K2 J1K1 JoKo

000 00 00 11 001

001 00 11 11 010

010 00 00 11 011

011 10 11 11 100

100 01 00 00 000

101 01 11 00 011

110 01 00 00 010

111 11 11 00 001

Nota: Un contador autocorregible es aquel en el que , los estados sin utilizar regresarn de alguna forma a
la secuencia de conteo normal. Si alguno de estos estados no utilizados no puede regresar a la secuencia
normal, no es autocorregible
 CONTADOR SINCRONO
Diagrama de estado
 CONTADOR SINCRONO
Ejercicio propuesto:
Obtener la secuencia del contador y determinar si es autocorregible

1 1
3 3
2 2

14 12 14 12
J Q J Q
14 12 14 12
J Q J Q
1 1
CLK CLK
1 1
CLK CLK
3 13 3 13
K Q K Q

R
3 13 3 13
K Q K Q
R

2
2

(CLK)
 CONTADOR SINCRONO
Ejercicio propuesto:
Obtener la secuencia del contador y determinar si es autocorregible

U3:A
1
3
2
U3:B 1
4 3 74LS09
6 2
5

74LS09
U2:B U2:A U1:B U1:A
74LS73 74LS73 74LS73 74LS73

9 7 12 14 9 7 12 14
Q J Q J Q J Q J
5 1 5 1
CLK CLK CLK CLK
8 10 13 3 8 10 13 3
Q K Q K Q K Q K
R

R
U2:B(CLK)
6

2
U4

NAND_4
CONTADOR ASINCRONO

Contador
74LS163
Contador 74LS163
 Contador 74LS163
Operacin del Contador
74x163:
Corrida libre hasta 16
Cuenta si ENP (CEP) y ENT
(CET) esta activos
Borrado si CLR (SR) se activa (Se
superpone a la carga y conteo)
Carga si LD (PE) se activa (se
superpone al conteo)
Todas las operaciones ocurren en
flancos de subida de CLK (CP)
RCO (TC) se activa si ENT se activa
y la cuenta alcanza el 15
 Contador 74LS163
Funcionamiento Libre del 74163

Divisor por 16
 PRECARGA DE UN CONTADOR

Secuencia de cuenta
modificada

Se carga el 0101 despus de contar el 15

5, 6, 7, 8, 9, 10, 11, 12, 13, 14, 15, 5, 6,
Funcionamiento como divisor por 11
Secuencia de cuenta
modificada (2)
Indique la
secuencia
de conteo
y la frec.
Contador sncrono en Cascada
 CIRCUTOS DIGITALES
OTROS CONTADORES
Circuito en bloques de un
contador binario de 4 bits

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 Ejercicios
1.- Obtener un contador MOD 13. Use 7493.
2.- Mediante 74293 construir un contador MOD 60
3.- Usando 7490 y siendo la frecuencia de entrada
100 HZ, haga las conexiones necesarias para
obtener a la salida 1Hz
4.- Haga las conexiones necesarias para que el
contador 74LS163A cuente MOD 13 con las
siguiente secuencia de conteo:
3, 4, 5, 6, 7, 8, 9, 10, 11, 12, 13, 14, 15, 3, 4, .