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Valentino Liberali Dipartimento di Tecnologie dellInformazione Universit` di Milano, 26013 Crema a e-mail: liberali@dti.unimi.it http://www.dti.unimi.it/liberali
M1 : Vth = 1 V, k = 100 A/V2 , W = 20 m, L = 1 m; VDD = 5 V; RD = 5 k. Trovare il punto di lavoro per vIN = 0 V, 1.5 V e 5 V.
Elettronica I Inverter con transistore MOS p. 2
indipendente da VDS
In questo caso, la corrente dipende anche dalla tensione di drain VDS = VD (VS = 0). Laltra equazione data dalla legge di Ohm per RD : ID = VDD VD RD
VDD VD RD
Elettronica I Inverter con transistore MOS p. 6
unequazione di secondo grado nellincognita VD : ha due soluzioni, di cui sicuramente una da scartare. Risolvendo, si ottiene VD = 8.08 V e VD = 0.12 V. Prima soluzione: VD = 8.08 V Avremmo VGD = 3.08 V < Vth = 1 V; questo contraddice lipotesi che M1 sia in triodo soluzione da scartare Seconda soluzione: VD = 0.12 V Avremmo VGD = 4.88 V > Vth = 1 V; questo conferma lipotesi che M1 sia in triodo soluzione valida
Elettronica I Inverter con transistore MOS p. 7
Leggendo la prima e lultima colonna, si ricava che il circuito realizza la funzione di una porta logica NOT (inverter):
X Y
4.0V
2.0V
3.0V
4.0V
5.0V
VDD VOH
za en nd -1 = pe za en nd -1 =
VOL VIL
VDD/2 VIH
VDD
vin
VDD VOH
za en nd -1 pe =
VOL VIL
VDD/2 VIH
VDD
vin
Se il segnale di ingresso minore di VIL , viene interpretato come uno 0 logico; se maggiore di VIH , viene interpretato come un 1 logico.
Elettronica I Inverter con transistore MOS p. 11
VDD VOH
za en nd -1 = pe za en nd -1 =
VOL VIL
VDD/2 VIH
VDD
vin
Se il segnale di ingresso compreso tra VIL e VIH , il valore logico dellingresso non ben determinato (potrebbe essere interpretato come 0 o come 1, in modo dipendente dai parametri dei componenti, dalla temperatura, dalle uttuazioni della tensione di alimentazione, . . . ).
VDD VOH
za en nd -1 = pe za en nd -1 =
VOL VIL
VDD/2 VIH
VDD
vin
Le tensioni VOL e VOH sono i valori estremi che luscita pu assumere quando lingresso ha un valore logico ben determinato (0 o 1). Per poter collegare le porte logiche in cascata, deve essere VOL < VIL e VOH > VIH afnch le uscite di una porta logica vengano sicuramente interpretate nel modo corretto dalla porta successiva.
Margini di rumore
vout
pe
VDD VOH
za en nd -1 = pe za en nd -1 =
VOL VIL
VDD/2 VIH
VDD
vin
I margini di rumore (NM: Noise Margin) sono: N MH = VOH VIH N ML = VIL VOL In pratica, qualunque disturbo di ampiezza inferiore al margine di rumore non pu far cambiare il signicato del bit.
Elettronica I Inverter con transistore MOS p. 14