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Facultad de Ingeniería
Universidad de Antioquia
Arquitectura de Computadores ISI355 (2011‐1)
Práctica No. 1
Diseño de circuitos combinacionales básicos
1. Objetivo
• Emplear los conceptos del álgebra Booleana en el diseño de circuitos
combinacionales.
• Conocer algunos circuitos integrados que contienen compuertas lógicas básicas.
2. Procedimiento
Esta práctica está dividida en tres partes. La primera es una familiarización con circuitos
integrados lógicos y su interconexión para la implementación de funciones lógicas. En la
segunda haremos el diseño de un circuito lógico bastante empleado en sistemas
digitales. Por último, tomaremos un problema cotidiano y buscaremos una solución en
forma de circuito lógico.
2.1. Circuitos integrados lógicos combinacionales de la familia 74LS
La familia 74LS de circuitos lógicos agrupa una larga lista de circuitos integrados
construidos con tecnología TTL (Transistor‐transitor logic) para la implementación de
sistemas digitales. Consulte las hojas de datos de los chips 74LS04, 74LS08, 74LS11,
74LS21 y 74LS32 y recopile la siguiente información1:
(a) Para cada chip, indique el tipo y número de compuertas que contiene. Copie el
diagrama de pines de cada chip. Estos diagramas servirán para conocer de manera
inmediata la función de cada pin de los chips, incluyendo los de polarización.
(b) Dibuje un esquema de interconexión con los circuitos integrados necesarios para
implementar la función lógica f(x,y,z) = xy + yz + xz
(c) Dibuje un esquema de interconexión con los circuitos integrados necesarios para
implementar el circuito lógico mostrado en la Figura 1.
Figura 1. Circuito lógico
1
Para consultar las hojas de datos puede usar la Web http://www.alldatasheet.com
2.2.Diseño de un decodificador de BCD a 7 segmentos
Los displays digitales que se encuentran en algunos relojes digitales y calculadoras
electrónicas están construidos con LEDs (diodos emisores de luz). Cada dígito del
display está formado por siete segmentos, siendo cada uno un LED que es accionado
por una señal digital. Un decodificador BCD a 7 segmentos es un circuito
combinacional que toma un dígito BCD y genera las salidas apropiadas para que los
segmentos desplieguen el dígito decimal correspondiente. Las siete salidas del
decodificador (A, B, C, D, E, F, G) accionan los segmentos correspondientes del
display, tal como se muestra en la Figura 2, en la que también se indica la designación
numérica para representar los dígitos decimales.
Figura 2. Designación de segmentos y representación de dígitos decimales en un display de 7 segmentos
Teniendo en cuenta la información previa, realice el diseño de un decodificador de
BCD a 7 segmentos siguiendo estos pasos y restricciones:
(a) Construya una tabla de verdad que describa la funcionalidad del decodificador.
Asuma que para encender un segmento es necesario un ‘0’ lógico, y que para
apagarlo es necesario un ‘1’ lógico.
(b) Emplee mapas de Karnaugh para obtener expresiones Booleanas simplificadas
(como suma de productos) para las salidas.
(c) Indique el número total de compuertas AND y OR necesarias para implementar las
siete salidas.
(d) Ahora, identifique los términos producto comunes en las siete salidas e indique el
número mínimo de puertas AND y OR necesarias para implementar las siete
salidas.
(e) Dibuje el diagrama circuital del decodificador usando el número mínimo de
puertas AND y OR.
(f) Usando solamente los circuitos integrados 74LS04, 74LS08, 74LS11, 74LS21 y
74LS32, dibuje un esquema de interconexión de los chips que implemente las siete
salidas del decodificador. Para el caso de las compuertas AND, use aquellas que
tengan un número de entradas igual al número de literales del término producto a
implementar.
(g) Indique cuál es el número de circuitos integrados de cada tipo necesarios para
realizar la implementación solicitada.
2.3. Sistema de control de tráfico
Para el problema planteado más adelante, determine una solución en forma de
circuito lógico. El procedimiento para llegar a la solución debe partir de la definición
de una tabla de verdad, que debe llevar a una expresión Booleana simplificada usando
mapas de Karnaugh, y de aquí a un diagrama circuital.
Figura 3. Control de tráfico en una intersección de calles
La Figura 3 muestra una intersección de dos calles. Asuma que existen sensores de
detección de vehículos a lo largo de los carriles A, B, C y D, y que se denotan de la
misma manera. La salida de un sensor es un ‘1’ lógico cuando hay vehículos presentes,
y un ‘0’ lógico cuando no los hay. Los semáforos Este‐Oeste (E‐O) y Norte‐Sur (N‐S) de
la intersección deben comportarse según estas reglas:
• El semáforo E‐O se debe poner en verde cada vez que haya vehículos en los
carriles C y D.
• El semáforo E‐O se debe poner en verde cada vez que el carril C o el carril D
estén ocupados, pero mientras los carriles A y B estén vacantes.
• El semáforo N‐S se debe poner en verde cada vez que los carriles A y B estén
ocupados, y por lo menos uno de los carriles C y D esté libre.
• El semáforo N‐S se debe poner en verde cuando por lo menos uno de los
carriles A y B esté ocupado, y mientras que los carriles C y D estén ambos
vacantes.
• El semáforo E‐O se debe poner en verde cuando no haya vehículos presentes
en ningún carril.
• Cuando solo haya un vehículo en los carriles C y D y otro en los carriles A y B, el
semáforo E‐O tendrá prelación.
Asuma que los semáforos se ponen en verde con un ‘1’ lógico, y en rojo con un ‘0’
lógico.
3. Informe
Cada equipo de trabajo debe realizar un informe escrito con una descripción detallada del
desarrollo de la práctica, atendiendo los requerimientos planteados a lo largo de la
presente guía. Se deben agregar cualquier tipo de observaciones relevantes y
conclusiones del trabajo.
4. Sustentación
Cada equipo debe demostrar un dominio completo del desarrollo de la práctica. El
profesor planteará preguntas para evaluar los conocimientos adquiridos, cubriendo los
siguientes aspectos:
• Análisis de hojas de datos de circuitos integrados lógicos.
• Interconexión de circuitos integrados lógicos.
• Definición de tablas de verdad.
• Simplificación de expresiones lógicas mediante mapas de Karnaugh.
• Implementación de circuitos usando compuertas lógicas básicas.
5. Evaluación
El informe escrito en formato PDF debe enviarse por correo electrónico al profesor
(farivera@udea.edu.co) antes de la fecha por él designada. La sustentación se hará en
hora y lugar acordados con el profesor. El informe tiene un peso del 30% en la calificación
de la práctica. La sustentación, por su parte, tiene un peso del 70%.