IPN ESIME CULHUACAN

Ingeniería en Computación

Circuitos Lógicos II
DCC Eusebio Ricárdez Vázquez
VHDL
Diseño lógico secuencial con VHDL
Diseño lógico secuencial:
Un sistema secuencial está formado por un
circuito combinacional y un elemento de
memoria encargado de almacenar de forma
temporal:

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Flip-flops
El elemento mas utilizado en el diseño de los
sistemas síncronos o asíncronos son los flip-
flops
D

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Flip-flop tipo D

NET "clk" CLOCK_DEDICATED_ROUTE = FALSE; #Quitar reloj interno

NET "clk" LOC = "G12" ; # BTN0

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Flip-flop SR

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Registros

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Contadores
use ieee.std_logic_unsigned.all

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Contadores use ieee.std_logic_unsigned.all

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Displays con contenido diferente
los displays mostraran CV13

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26/10/2017 Dr. Eusebio Ricárdez Vázquez 11
Laboratorio
Implementar un contador ascendente
descendente de 8 bits.

Mostrar contenido diferente en los

displays (CV13)

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Máquinas de estados finitos

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Maquina de estados finitos
Se usaran declaraciones case-when para
determinar el valor que tomara el siguiente
estado.
Para la transición entre estados se usará if-
then-else
Para representar los estados d0,d1,d2 y d3
se usará un tipo enumerado
Se utilizará una señal para los estados

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Máquina de estados finitos
type estados is (do,d1,d2,d3);
signal edo_presente, edo_futuro:
estados;
Para programar cada estado, se utilizará una declaración when
como se tienen varios estados, usaremos una sentencia case

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 Código completo

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Integración de entidades

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Integración de entidades
Programación de entidades individuales

Programación mediante relación

entradas-salidas

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Entidades individuales

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Entidades individuales (cont.)

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Relación entradas - salidas

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Relación entradas - salidas

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Relación entradas - salidas

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Laboratorio
Implementar un contador y mostrar la
cuenta en el display (un dígito)

Implementar un contador y mostrar la

cuenta en el display (cuatro dígitos),
utilizar reloj lento y rápido

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