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Examen Final
Ciclo 2017-2
UPC_FINAL 5V
330
a
b
c
d
¿? e
f
g
1
2. (4.0 puntos) Desarrollar un detector de secuencia binaria de un bit de ancho (→10110110)
considerando traslape e implementado con FFJK. Se tendrá dos salidas: Y para cuando la
secuencia es correcta y Z cuando se haya detectado el 50% de la secuencia correcta.
OBS: “D” es la entrada de datos.
UPC_DETC
Y
D ¿?
Z
2
b) (2.0 puntos) Circuito lógico secuencial.
3. (4.0 puntos) Marcar verdadero (V) o falso (F) para los siguientes enunciados:
(0.5 puntos c/u)
1.1 Un contador asíncrono es el que no posee reloj y tiene reset. (F)
1.2 Si una MEF Mealy tiene 2 entradas, tendré 4 transiciones de salida. (V)
1.4 El timer 555 en modo astable arrojará un pulso de ancho determinado por la ( F )
ecuación T = 1.1 * R * C y por acción de la entrada Trigger.
1.7 Los registros sirven para almacenar datos de manera temporal. (V)
1.8 Las memorias SRAM son memorias volátiles, mientras que las memorias ( F )
DRAM son memorias no volátiles.
3
4. (4.0 puntos) Una máquina expendedora de café debe ser controlada por un circuito secuencial
de Mealy (ver figura). Dicho circuito recibe como entradas el código de dos bits (tabla 1) de
las monedas que va introduciendo el usuario. Como salidas, el circuito debe activar 2 señales,
correspondientes a si se debe o no entregar el tabaco (T), y la cantidad de cambio a reintegrar
(C1 y C0), codificadas según las tablas 2 y 3 respectivamente.
El funcionamiento del circuito es el siguiente. El usuario debe introducir monedas hasta
alcanzar la cantidad de 1.5 soles, que será el precio del café. Asumir que la cantidad máxima
de monedas es hasta 3 soles.
Por ejemplo, si el usuario ha introducido 1 moneda de 50 céntimos y 1 moneda de 2 soles, la
maquina debe servirle el café y una moneda de 1 sol (considere como salidas TC1C0 = 110).
M1 M 0 Significado
0 0 No hay moneda
0 1 Moneda de 50 céntimos
1 0 Moneda de 1 sol
1 1 Moneda de 2 soles
Figura 1: Máquina expendedora de café. Tabla 1: Codificación de la entrada M.
T Significado C1 C0 Significado
0 No servir café 0 0 No hay cambio
1 Servir café 0 1 Cambio de 50 céntimos
Tabla 2: Codificación de la salida T. 1 0 Cambio de 1 sol
1 1 Cambio de 1.5 soles
Tabla 1: Codificación de la entrada.
10/100; 11/110
11/101
00/000 01/000
E0 E1 00/000
10/000
01/100 01/000 Codificación:
10/101 E0 = 00, tiene 0 soles
11/111 E1 = 01, tiene 0.50 soles
E2 = 10, tiene 1.0 soles
E2 00/000
4
b) (1.5 puntos) Tabla de estados usando F/F D y mapas de karnaugh.
SOLUCION
5
5. (4.0 puntos) Se tiene un convertidor DAC ideal de 10 bits, con tiempo de estabilización total
tset de 12 µs. Está conectado en una configuración con VREF- a tierra y VREF+=12 V. Al
respecto:
b) (1.0 puntos) Calcule la máxima salida análoga y el error de escala completa expresado
como porcentaje de la misma.
SOLUCION
La máxima salida análoga se produce para una entrada digital: 1111111111 = 1023 decimal
Por lo tanto:
𝑽𝒐𝒍𝒕𝒂𝒋𝒆 𝒎á𝒙𝒊𝒎𝒐 = 𝟏𝟎𝟐𝟑 ∗ 𝑳𝑺𝑩 = 𝟏𝟎𝟐𝟑 ∗ 𝟎. 𝟎𝟏𝟏𝟕𝟑𝑽 = 𝟏𝟐 𝑽
De donde: x = 0.098%
d) (1.0 puntos) Determine si una frecuencia de trabajo del DAC de 150 kHz respeta sus
condiciones de operación. Justifique.
SOLUCION
La frecuencia de entrada o trabajo del DAC determina la “cantidad de veces por segundo
que el DAC debe convertir la entrada digital en salida análoga”. Es evidente que, para una
operación fiable, no puede exigírsele al DAC que realice la conversión en un tiempo menor
al de estabilización.
Por tanto, para una frecuencia de trabajo de 150 KHz, se tendría que el tiempo entre
conversiones debe ser T = 1/F = 6.67 µS, pero como el DAC tiene 12 µS como tiempo de
estabilización para la salida, entonces la frecuencia de trabajo NO es apropiada para el
conversor.