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INFORME DE LABORATORIO
CDIGO DE LA
CARRERA NOMBRE DE LA ASIGNATURA
ASIGNATURA
ELECTRNICA E
ELEE14006 CIRCUITOS DIGITALES
INSTRUMENTACIN
PRCTICA DURACIN
LABORATORIO DE: ELECTRNICA DIGITAL
N (HORAS)
1 TEMA: LATCHES Y FLIP - FLOP 2
1 OBJETIVOS
2 INSTRUCCIONES
A. EQUIPO Y MATERIALES NECESARIOS
B. INTRODUCIN.
LATCHES
El latch(cerrojo) es un tipo de dispositivo de almacenamiento temporal de dos estados (biestable), que se
suele agrupar en una categora diferente a la de los flip-flops. Bsicamente, los latches son similares a los
flip-flops, ya que son tambin dispositivos de dos estados que pueden permanecer en cualquiera de sus dos
estados gracias a su capacidad de realimentacin, lo que consiste en conectar (realimentar) cada una de las
salidas a la entrada opuesta. La diferencia principal entre ambos tipos de dispositivos est en el mtodo
empleado para cambiar de estado.
LATCHES S-R
Un latch es un tipo de dispositivo lgico biestable o multivibrador. Un latch S-R (Set-Reset) con entrada
activa a nivel ALTO se compone de dos puertas NOR acopladas, un latch con entrada activa a nivel BAJO
est formado por dos puertas NAND. Observe que la salida de cada puerta se conecta a la entrada de la
puerta opuesta. Esto origina la realimentacin (feedback) regenerativa caracterstica de todos los latches y
flip-flops.
FLIP FLOPS
Los flip-flops son dispositivos sncronos de dos estados, tambin conocidos como multivibradores
biestables. En este caso, el trmino sncrono significa que la salida cambia de estado nicamente en un
instante especfico de una entrada de disparo denominada reloj (CLK), la cual recibe el nombre de entrada
de control, C. Esto significa que los cambios en la salida se producen sincronizada mente con el reloj.
Un flip-flop disparado por flanco cambia de estado con el flanco positivo (flanco de subida) o con el flanco
negativo (flanco de bajada) del impulso de reloj y es sensible a sus entradas slo en esta transicin del reloj.
En esta seccin se cubren tres tipos de flip-flops disparados por flanco: S-R, D y J-K.
3 ACTIVIDADES A DESARROLLAR
CIRCUITO 1
S R Q Q
0 0 1 1
0 1 1 0
1 0 0 1
1 1 Q Q
CIRCUITO 2
S R Q Q
0 0 Q Q
0 1 0 1
1 0 1 0
1 1 0 0
CIRCUITO 3
D Q Q
0 0 1
1 1 0
CIRCUITO 4
E S R Q Q
0 0 0 0 1
0 0 1 0 1
0 1 0 0 1
0 1 1 0 1
1 0 0 0 1
1 0 1 0 1
1 1 0 1 0
1 1 1 1 1
CIRCUITO 5
E D Q Q
0 0 0 1
0 1 0 1
1 0 0 1
1 1 1 0
CIRCUITO 6
CLK J K Q
0 0 No cambia
0 1 0
1 0 1
1 1 Cambia
CIRCUITO 7
Qa Qb Qc
0 0 0
0 0 1
0 1 0
0 1 1
1 0 0
1 0 1
1 1 0
1 1 1
CIRCUITO 8
Qa Qb Qc
1 1 1
1 1 0
1 0 1
1 0 0
0 1 1
0 1 0
0 0 1
0 0 0
5 CONCLUSIONES
6 RECOMENDACIONES
https://sites.google.com/site/electronicadigitaluvfime
http://www.bibliotechnia.com.mx/Busqueda/resumen/2237_2087180
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Elaborado por:
Jonathan Basantes
Alex Caar Ing. Sixto Reinoso V.
Docente de la asignatura