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Integrantes:
Carlos Enrique ngel - 1088336202
Daniel Botero Rojas - 1088331163
UART donde en este mdulo lo que hacamos simplemente era unificar los tres
mdulos anteriores, donde en total se generaba el protocolo RS232.
Este mdulo tiene 4 entradas y 3 salidas, donde las entradas corresponde al clk que
se uno al FrequencyDivider y su salida se unificaba al clk de los mdulos Rx y Tx, y
el resto de entradas iban conectas en los respectivos mdulos Rx y Tx al igual q las
salidas.
Aqu terminbamos el protocolo, pero tenamos que agregar un mdulo ms para
poder probarlo, donde en este lo que hacamos era implementar una
retroalimentacin con el Rx y el Tx con seales que habamos creado. Entonces
este mdulo simplemente reciba 2 entradas y 1 salida, donde las entradas eran el
clk y los bits que iban ingresando uno por una, y la salida deba ser los mismos bits
que iban entrando.
Inconvenientes:
Tuvimos inconvenientes mientras realizbamos el mdulo Tx en el momento
de calcular la paridad, hasta que despus de acomodar algunas
condicionales pudimos hacerlo.
Otro inconveniente fue cuando probbamos y le envibamos ms de dos
datos a la vez, ah lo nica que hacamos era simplemente era reiniciar
contadores que tenamos y listo.
Otro fue cuando nos llegaban dos datos seguidos, despus del bit de parada
entraba el bit de inicio, sin un bit de idle; para poder arreglar esto
modificamos el mdulo Tx en la condicin donde hacia los corrimientos para
ir sacando los bits.
Bibliografa:
nexys2_reference_manual.pdf