Documenti di Didattica
Documenti di Professioni
Documenti di Cultura
teoM^n
INMOVACIN
PARA LA EXCELENCIA
INTEGRANTES:
1 Wiliam Moreno
2 Fernando Chiriboga
3 David Pea
RESUMEN
2. SISTEMA DE OBJETIVOS
- GENERAL
Comprobar las tablas de verdad por medio de la implementacin de las
compuertas complementarias a un circuito cerrado.
- ESPECFICOS
Simular el funcionamiento de las compuertas complementarias.
Mediante un circuito expandir las compuertas complementarias en funcin d
las primarias.
3. MARCO TERICO
Compuertas Lgicas
La construccin de las compuertas lgicas, est basada en componentes
discretos (Transistores, Diodos, y Resistencias), pero con la enorme ventaja de
que en un solo circuito integrado podemos encontrar 1, 2, 3 o 4 compuertas
(dependiendo de su nmero de entradas y propiedades).
Todos los circuitos internos de las compuertas estn/conectados de manera
que las entradas y salidas puedan manejar estados lgicos (1 o 0).
Tablas de verdad
Una tabla de verdad es una tabla que nos muestra la manera en que reacciona
la salida de una compuerta o circuito lgico, en funcin de sus entradas. En la
tabla se describen todas las posibles variables de entrada y las consiguientes
variables de salida.
Compuerta OR
La siguiente imagen nos muestra e/proceso de unin de las compuertas OR y
NOT para darnos como resultado I compuerta OR.
Compuerta OR
C o a p u e c t a OR
compuerta
NOT
t
Compuerta N(|
B
Fig.1. Combinacin pard a compuerta or
La tabla de verdad nos revela la diferencia entre una compuerta OR y una
OR.
Entradas
A
0
1
0
1
Salida OR
Salida O R
Z
0
1
1
1
Z
1
0
0
0
B
0
0
1
1
de la salida OR, en
"taduciendo"
Operacin OR - Z = + B
Z es igual a mas B
"traduciendo"
A -r
B o
CcMpuerta
A -i
B -
AND
AND
i > - ^
Compuerta
Compuerta
A B -
NOT
NAND
Entradas
B
Salida A N D
Z
Salida N A N D
Z
0
1
0
1
0
0
1
1
0
0
0
1
1
1
1
0
Operacin M ) - Z = * B
Operacin NAND - Z = * B
"traduciendo"
"traduciendo"
ZesialaporB
Not
AND
OR
EX - OR
Fig.5. Combinacin para ia compuerta x-or
A
0
0
1
1
/Salida
0
1
0
1
0
1
1
0
Si A y B son 1, Z ser O
Si A y B son O, Z ser O
Si A es 1 y B es O, Z ser 1
7
Si A es o y B es 1, Z ser 1
m k\|{k^kpl]m{|^]
AND
OR
EX - OR
Fig.7. Combinacin para la compuerta x-nor
La siguiente tabla representa la tabla de verdad para una compuert^tipo OR
Exclusiva ( E X - O R ) .
Entradas
Salida
0
0
1
1
0
1
0
1
1
0
0
1
La tabla de verdad nos lleva a la conclusin de que si las dos entradas de una
compuerta OR Exclusiva son de igual valor, la salida siempre ser ALTA, y si
son de diferente valor, la salida siempre ser BAJA.
Si A y B son 1, Z ser 1
Si A y B son O, Z ser 1
Si A es 1 y B es O, Z ser O
Si A es O y B es 1, Z ser O
Z = * B + A* B
se "traducira" como
La siguiente imagen nos muestra ambos smbolos para las cinco compuertas.
Smbolo clsico
C o m p u e - t r t a
O R
C-on-pu(sir-ta
- O -
AND
^^^O
4. EQUIPOS Y MATERIALES
-Protoboard
-Multmetro
-Compuertas lgicas and, or y not
-Compuerta lgica nand, x-or or y x
-Dip switch
-Resistencias 10k y 330D
-Laptop
-Cables utp
-Leds
-Fuente de voltaje 5v
10
5. DESARROLLO DE LA PRCTICA
a) Armar en el Crocodie el siguiente circuito y probar la tabla de verdad.
b) Armar en el simulador Protoboard los circuitos del literal a).
COMPUERTA X-OR
1.
Salida
ab
Entrada
Salida
0
1
1
0
1
1
11
10
15
20
25
30
50
40
55
60
C * <
B *
* -jt *
w If i
^^^jE^^j^J ,< H .W
t
K ir
&>CCCCCCCC
iO
i5
20
25
30
35
40
45
50
f ^ w B
-4 w D
20
25
30
35
M S "
40
45
50
55
H H
<
a w
H T( *
I w<
J T . >f
:W W W
5-
.i<
K Mi
60
COMPUERTA X-NOR
1.
Salida
,,
(.
/7. 7
Salida
ab
13
vcc
2<
_l "
"
50
5S
Jf'
14
COMPUERTA N-AND
1.
Salida
a.b
a.b
0
0
1
1
2.
Salida
a.b
a.b
1
1
20
25
30
45
50
55
SO
64
^ . .
. ^ / y < i< * ,i H
< ^ / -.r. ^ ^ .1 ^ * ^ ^ * t f V < t <e. m. Kne fl H/r. i
V
W i{ * * * nf l
( X
J
40
45
S
55
60
64
V if * E
GND
K l . .t w
^1
COMPUERTA N-OR
1.
Salida
a+b
a+b
1
0
1
1
1a
ft:
t-W
^7
Salida
a +b
a+b
1
1
1
1
n :
K *
# * I
S H :
V^CCECCC!CC
10
15
20
25
30
iO
25
30
. n n le m <e M * X
35
40
45
50
55
60^
64
40
45
50
55
60
64
r a * if a- w * -* s l A
H! .^Hgt
fch-,
f '
< '
if if - ^ .
- *
I > K * * * * * J
* ^VV
w ifiJiniroi-ii! r..'_'i
V C C < %-HW.
:j> M M * je * I
r>CkCCCCCC
Fig.16. Compuerta or en simulador protoboard
18
3.
Crocodile
Entrada
Salida
ab
'
Protoboard
Entrada
Salida
19
10
15
20
^ ^
25
* ^ < * *
20
25
> l
i(
w jl
* * <
30
40
^ t,
* ft
35
45
50
* ^ ^ ^ ^ * f J ^ ^ ,
%
0,
SO
64
i ^ 4 ^ i * ^ ^ * J .-i
40
45
60
5S
60
64
40
45
50
55
60
64
If i( W
20
21
0+1=0
22
Compuerta nand
0*0=1
24
25
100=0
Compuerta x-nor
00=0
27
100=1
vtm
28
Salida
ab
aJ
1
-* t
1
i
i1
w^
1
1
/7
Protoboard
Entrada
Salida
a@b
30
8. CONCLUSIONES Y RECOMENDACIONES
9 Las compuertas lgicas son los dispositivos electrnicos ms sencillos que
existen, pero al mismo tiempo son los ms utilizados en la actualidad.
^ Las compuertas Lgicas complementarias se obtienen de la combinacin de
las compuertas bsicas.
&
i.
31
10. ANEXOS
DM74LS32
Q u a d 2-lnput O R G a t e
G e n e r a l Descrption
TlBS d e v i c e axmma
lom treJependent g a i e s e a c h of wM<^
perWTOs ttw logic C>R fcinction.
Ordering C o d e :
Or<ier N u m b e r
P a c k a g e Mumber
Package Oescriptkm
M14A
Dyl74LS32&J
C<I74S.S32N
N14A
m uip* aros Reet. sstcay
C o n n e c t i o n Oiagrann
Vcc M
II, 5,3cnm W k l e
F u n c t i o n Table
*4 aa A3 va
*4
Output
5>l
l.
i-
i/
H - HMSM L O ^ L
. - .OW t o a c l . S *
1
*i
2
B
9
TI
4
2
Ya
<
DM74LS08
Quad 2-lnput AND Gates
General Oescription
d e v i c e contem Icmr independent g a t e s e a c h o f ihic>
perfiofms m e logic A N D ^jnctioo.
TTKS
Ordering Code:
O d e r NunM>er
P a c k a g e Descrption
OM3*4LS08M
OM74L.S08SJ
MI4A
Mt4D
N14A
Connection Oagram
A*
Function Table
V4
tnputs
A
L
L
M
H
B
L
H
L
H
L
L
lH
32
DM74LS04
Hex inverting G a t e s
G e n e r a l Oescription
Thts o e v i c e c o n t a i n s six independent g a t e s e a e i of w t v c h
perfcxms the logic I N V E R T funcioo-
Ordering C o d e :
Order Nuniber
Paclcage riumber
Package Oescription
DM74LSQ4M
DM74LS04SJ
M14A
M14D
DM74LS04N
N14A
C o n n e c t i o n Diagram
F u n c t i o n Table
Y =A
12
Input
A'
-Oo-
'
Output
Y
M - mGfi L09C Lv
L ~ .CW
L*vt
>
'
1'
DM74LS86
Quad 2-lnput Exclusive-OR Gate
General Descrption
T h i s d e v i c e c o n l a a i s four m d e p e n d e n t g a t e s e a c h of w h i c h
performs ttie iogic e x c l u s h e - O R function.
Ordering Code:
Order
Number
Package
Number
Package
Descrption
DM74LS86M
M14A
DM74LS86SJ
M14D
1 4 - L e a d S m a l l OutUne P a c k a g e ( S O P ) . E l A J T Y P E II. 5 . 3 m m W i d e
DM74LS86N
N14A
1 4 - L e a d Plstic O u a t - l n - L i n e P a c k a g e { P D i P ) , J E D E C M S - 0 0 1 . 0 . 3 0 0 W k J e
Narrow
Dtvaes auo awailabi* m Tape and Fi) S p e c ^ by 3(}pe<vsngffiesuff tener T r o P orotrna eo<
Connection Diagram
Vcc
*4
Function Table
Y=AB = ABtA"
Output
Inputs
A
Y
L
Al
Bt
TI
AS
Vi
GNO
33
DM74LS00
Ordering Code:
Order N t a n b e r
Package Number
P a d c a g e Oescription
M14A
DM74SQ0&1
DM74L^X3N
M140
14-Lead SfrK*iOuBinentegraedCxiit{Sac:!,JEDC'MS:^^^
14-Lead S m ^ 0!ine Pa<*a9e (SC*-). ElAJ TYPE l. 5.3mm Wide
N14A
Connection Diagram
m
V n
Function Table
t i
Y==AB
I I
A
L
En
Output
Y
H
H
H
i
L
H
L
H
H
Pi
'
L
H
i-avw
DM74LS02
Ordering Code:
Orcer Number
Package H i i m b e r
DM74tS02'M
DM74S02SJ
DM74tH)2N
M140
Package Oescription
/
14-LeaS Sn^l Oiline Integrjwed Circiat <SOC i. JEDEC MS-120, 0.1|0 Narrow
14-Lead SmaB Oiir>e P a c k a g e SOP>. E l A j n r P E H, 5.3mm Wide '
N14A
M14A
D*v.o * s o
Connection Diagram
*^
^*
Function Table
Vi
^>
Inputs
A
L
L
H
H
1 . . L o m togc
B
L
H
L
H
' "
OMput
Y
H
t
L
DM74LS266
Quad 24nput Exclusve-NOR Gate
wlth Open-Collector Outputs
General Oescription
This device contar four irKependenS gates eaeh <^ wtiich
performs the to^ exckmve-HOR
fcncSon.
Outpias are
open colector.
Ordering Code:
Order Ntimber
DM74S266M
t4LS266N'
ofsmKeKisMasM*B
Package Humber
^14A
N14A
Package Oescription
14-Lea< Smafl Ouairte t n t e g r a e d p t s t j r t (SaC). 4EDEC fiS-t20, O.ISO Hmo<i
14-Lead P l a ^ a i a - l r M j o * ^ i c k s ^ PDfP?, JEDEC M S - M , 0.3K} VWde
1^anaS|s*y'^l^S^lK5^^^Totnsraerngcae.
Connection Diagram
Truth Table
Outputs
Inputs
A
L
H
L
H
H
L ' LOW vcttage Levei
35