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Facultad de Ciencias
Arquitectura de computadores
Introduccin
Dispositivos de E/S pueden ser caracterizados por:
Comportamiento: entrada, salida, almacenamiento
Interaccin: humano o mquina
Velocidad de datos: bytes/segundo, transferencias/segundo
Introduccin
Confiabilidad
Desarrollo del Servicio
Servicio entregado
como se especifica
Restauracin
Fracaso
Medidas de fiabilidad
Fiabilidad: tiempo medio entre fallos (MTTF)
Interrupcin del servicio: tiempo medio de reparacin
(MTTR)
Tiempo medio entre fallos
MTBF = MTTF + MTTR
Disponibilidad = MTTF / (MTTF + MTTR)
Mejora de la disponibilidad
Aumentar MTTF: evitar, tolerar, la previsin de fallos
Reducir el MTTR: mejora de los instrumentos y procesos
para el diagnstico y reparacin
Lic. Martn Cruz
Almacenamiento en disco
No voltil, almacenamiento magntico de rotacin
Problemas de rendimiento de
disco
Promedio en tiempo de bsqueda de los fabricantes
Basado en todas las bsquedas posibles
Controlador de disco inteligente asigna sectores fsicos
sobre el disco
Interfaz actual de sector lgico para alojar
SCSI, ATA, SATA
Las unidades de disco incluyen cachs
Sectores Prefetch en previsin de acceso
Evita el retraso de rotacin
Almacenamiento Flash
Almacenamiento semiconductor No voltil
100x ---- 1000x ms rpido que disco
Ms pequeo, consumo bajo, ms robusto
Pero ms $/GB (entre el disco y la DRAM)
Tipos de Flash
Flash NOR: celdas como una compuerta NOR
Acceso aleatorio de lectura / escritura
embebidos
Flash NAND: celda como una compuerta NAND
Ms densa (bits/rea),
Ms barato por GB
Utilizado para llaves USB, almacenamiento de medios, ...
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Interconectando Componentes
Se necesitan interconexiones entre :
CPU, memoria y controladores de E/S
Bus: canal de comunicacin compartido
Conjunto de cables de datos paralelo y
sincronizacin de transferencia de datos
Puede convertirse en un cuello de botella
Rendimiento limitado por factores fsicos
Longitud del cable, nmero de conexiones
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Tipos de buses
Buses Procesador-Memoria
Memoria
Buses de E/S
Ms largas, permite mltiples conexiones
Especificado por normas(standards) para interoperabilidad
Se conecta al bus Procesador-Memoria a travs de un
puente
Buses grficos, son otros con caractersticas diferentes y que
realizan funciones especiales
Lic. Martn Cruz
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Lneas de Control
Indica tipos de datos, sincroniza transacciones
Sncrono
Incluye un reloj en las lneas de control y un protocolo de
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Firewire
USB 2.0
PCI Express
Serial
ATA
Serial
Attached
SCSI
Tipo de bus
Externo
Externo
Interno
Interno
Externo
Devices per
channel
63
127
Data width
2/lnea
Ancho de banda
pico terico
50MB/s o
100MB/s
0.2MB/s,
1.5MB/s, o
60MB/s
250MB/s/lnea 300MB/s
1, 2, 4, 8,
16, 32
300MB/s
Conectable en
caliente
Depende del
tamao
Longitud mxima
del bus
4.5m
5m
0.5m
1m
8m
Nombre del
estndard
IEEE 1394
USB
Implementers
Forum
PCI-SIG
SATA-IO
T10
Committee
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Interconexiones de E/S en
procesadores x86
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Explicacin
Es una organizacin del sistema de E/S en un servidor basado
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2 serial ATAs:
150 MB/s
2 parallel ATA:
100 MB/s
DDR SDRAM
Main
Memory
Hub Bus: 8b x 266 MHz
PCI:
32b x 33 MHz
8 USBs:
60 MB/s
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Gestin de la E/S
Entrada y salida es mediado por el SO(Sistema operativo).
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Direccionamiento de
dispositivos de E/S
Para enviar un comando a un dispositivo de E/S, el procesador
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Comandos de E/S
Causan que el dispositivo de E/S realice algo. En un proceso de
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Comunicacin con el
procesador
Se realiza utilizando varios mtodos:
Encuesta (polling). Comprueba peridicamente el estado de
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Encuesta
Peridicamente revisa el registro de estado del dispositivo de
E/S
Si el dispositivo est listo, realiza la operacin
Si hay error, toma medidas al respecto
Comnmente usado en sistemas embebidos pequeos y de
bajo rendimiento
Costo bajo en el hardware
En otros sistemas, se considera un prdida de tiempo del CPU
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Interrupciones
Cuando un dispositivo est listo o errores ocurren
El controlador interrumpe al CPU
Prioridad de Interrupciones
Los dispositivos que necesitan atencin ms urgente consiguen
prioridad ms alta
Lic. Martn Cruz
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manera autnoma
Controlador interrumpe al completar o cuando sucede un error
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rendimiento
Por ejemplo, en la transferencia sobre el bus de datos a
memoria
Colisin con el mecanismo de refresco de la DRAM
Problemas con otros buses
Por ejemplo, bus PCI: el pico del ancho de banda ~133
MB/segundo
En la practica, es sostenible slo un mximo de
80MB/segundo
Lic. Martn Cruz
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Conclusin
Medidas de desempeo de Entrada/Salida
Rendimiento, tiempo de respuesta
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