Practica 3. Contador de 0 a 999 Practica 3.

Arquitectura de Computadoras

BENEMERITA UNIVERSIDAD
AUTONOMA DE PUEBLA
FACULTAD DE CIENCIAS DE LA
ELECTRONICA
Arquitectura de computadoras
Practica: 3
Aplicacin del procesador
(Contador de 3 dgitos)
Tipo de reporte: formato reporte tcnico
David Flores
Romn Garca Flores
Prctica
Contador de 3 dgitos
Tipo: Formato tipo Reporte Tcnico
1. Introduccin
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Facultad de ciencias de la Electrnica

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El procesador diseado anteriormente para esta materia tubo una serie de aplicaciones para
ver desde el principio de funcionamiento, y las partes que lo forman ya que dependiendo
del tipo de instrucciones y el tamao de almacenamiento de ellas requiere modificar varios
parmetros.

2.

Objetivo

Con esta prctica se busca empezar a adquirir una vista del procesador operando 3 display,
de tal forma que realice un conteo, con diferentes parmetros de tiempo entre cifra.

Planteamiento del Problema

Disear un cdigo en ensamblador, para hacer que el procesador haga un conteo usando 3
display desde cero hasta el desborde de 999, con un efecto de barrido en cada display
mediante un arreglo de transistores.

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3.

Marco Terico

El mtodo que usamos para realizar el cdigo ensamblador a lenguaje maquina fue MARS,
ya que tiene funciones que se apegan cercanamente a las de mips, y nos permite simular su
comportamiento.

Comportamiento del Procesador:

4.

Desarrollo del Sistema

Una vez tenido la idea de su implementacin se realiz el montaje de los 3 display, tal y
como est en la imagen.

Despus se comenz a trabajar en cdigo ensamblador bajo las caractersticas que

buscamos y bajo el sistema que implementamos;
1.-Hacer un reloj central que tendr el control en el retardo de todas las instrucciones

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2.-Generar un solo contador del cero al nueve, y de ah hacer 2 contadores ms para obtener
un total de 3 contadores

3.-Intercalar cada contador para las unidades, decenas y centenas

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4.-Darles un orden a cada uno mediante un ciclo for, comparadores y saltos condicionales.
Finalmente se genera el block de cdigo maquina desde el mars y este se edita, con la
intencin de agregar las comillas y comas que iran en el cdigo del procesador ise.
----------CODIGO MAQUINA DEL CONTADOR 3 DIGITOS--------

IMPLEMENTADANDO EN LA FPGA
1.- Especificaciones de la SPARTAN XC6SLX9

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2.- Mapa de pines SPARTAN XC6SLX9

Ya visto lo anterior adems de ver el comportamiento de los componentes del procesador y

una vez unidos en un solo top se comenz a realizar el archivo UCF para tener listas las
entradas y salidas de todo el procesador, y tener listos los pines a asignar en el FPGA.

Se comienza a cablear los pines de la FPGA y el protoboard con los display ya montados.
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Anlisis de Resultados
Los resultados obtenidos fueron los deseados respecto al cdigo y los propuestos por el
mtodo al que implemento el procesador y las caractersticas del mismo, se rectificaron
operacin por operacin con display variados de nmeros, adems con el sistema de
multiplexado para as ver que el sistema satisface los resultados.

7. Conclusiones
Nos ha quedado claro sobre el mtodo de uso de un compilador de MIPS para operar
cdigo ensamblador, en este caso el compilador MARS, adems de ser una gran
herramienta que nos permite simular el cdigo, tambin nos genera el archivo de lenguaje
mquina, y as nos facilita el la forma para generar nuestras instrucciones al procesador.
El procesador al ser un sistema secuencial puede ser muy til para mltiples tareas y que en
el caso de los display fue ms interesante ver su funcionamiento ya que cada instruccin se
ejecuta en 40nseg. (Tiempo no notorio a la vista del ser humano), as que en el momento
del swicheo de los display, aparentemente no se llega a notar conforme la cuenta siga
ascendiendo.

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