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En esta leccin se presenta el esquema de funcionamiento de un computador, analizando las unidades centrales que lo componen y cmo se interconectan: El procesador Elementos internos Temporizacin en la ejecucin de instrucciones Concepto de microprocesador y microcontrolador Procesadores RISC y CISC Jerarqua de memoria Estructuras bsicas de computadores Computadores personales (PC) Paralelismo
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CONCEPTOS PREVIOS FUNCIONAMIENTO INTERNO DE UNA COMPUTADORA EL PROCESADOR EL CONCEPTO DE INTERRUPCIN JERARQUA DE MEMORIA ESTRUCTURAS BSICAS DE INTERCONEXIN COMPUTADORES PERSONALES (PC) PARALELISMO EN COMPUTADORAS CONCLUSIONES
Introduccin a la Informtica A.Prieto (c) McGraw-Hill / Interamericada de Espaa 3
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Entradas (E)
Salidas (S)
Perifricos
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En esta leccin vamos a utilizar como mdulos constructivos, los siguientes elementos (Captulo 4):
Biestables Registros Contadores ALU Memoria principal Puertos de E/S Buses
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Biestables
Elemento de memoria (Z) que almacena 1 bit. Carga en el biestable Z de un 1: Z1
1 0 0 0 Z 1 1 1 Z 1
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entrada
Seal de control
1 0 1 0 0 1 0 1
Registro: Memoria para almacenar un dato, direccin o instruccin individual Suelen ser de 8, 16, 32, 64 128 bits Una seal de control hace que se cargue la informacin de entrada, y cambie su contenido Ejemplo de carga: R7 RM
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salida
Contadores
Ascendente de 8 bits: 0, 1, 2, 3, 4,...., 255, 0, 1,.... (en binario) Incremento: PC PC+1 Carga en paralelo: PC DR
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ALU
BS BA op BS La operacin a efectuar se establece con las seales de control. P.e., suma Seales de control: 001 Operacin: BS BA + BS
Dato 1
Dato 2
BA
BB ALU
Seales de control
BS
Resultado
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Se divide en posiciones o palabras de memoria. Para leer o escribir, es necesario proporcionar la direccin de acceso. Una memoria dispone de las siguientes E/S: Entrada de datos (DBI) Salida de datos (DBO) Entrada de direccin (AB) Seales de control: IO/M=0 operar con la memoria R/W=0 escribir; R/W=1, leer
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16 hilos
16 hilos
Direccin (AB)
2m
Escritura en memoria:
M(AB) DB
Lectura de memoria:
DBO M(AB)
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Puertos de E/S: Desde el punto de vista del procesador cada perifrico es un conjunto de registros, que se denominan puertos de E/S Para leer o escribir en un puerto: hay que proporcionar su identificacin binaria (direccin), y generar las siguientes seales de control: 9 IO/M=1 operacin de E/S 9 R/W=0 salida; R/W=1, entrada
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Memori a central M
IPv
Procesador o
Bus de direcciones Bus de datos Bus de control
OPv
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Unidad de tratamiento rD
RF RT FF Z ALU S C V AR DR
reloj
Unidad de control
r1 r0
SP IR PC
Lgica de control
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Banco de registros de uso general (RF: r0 a rD) Almacen temporal de datos y/o direcciones Registro temporal (RT)
rD
RF
RT
r1 r0
ALU
F F Z S C V
SP o IR PC
Lgica de control
AR
DR
Biestables indicadores o de condicin (FF): C: Acarreo S: Indicador de signo (si el ltimo resultado de la ALU es negativo: S=1) Z: Indicador de cero (si el ltimo resultado de la ALU es cero, Z=1) P: Indicador de paridad (si la paridad del ultimo resultado es par, P=1) V: Indicador de desbordamiento El conjunto de estos biestables forma la palabra de estado (o SW, "Status Word").
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Unidad de control
r1 r0
SP o IR PC
ALU
Lgica de control
AR
DR
Registro de direccin (AR), donde deber ubicarse la direccin del dato/instruccin a leer o escribir en memoria (o de un puerto de perifrico) Registro de datos (DR), donde se almacenar el dato a escribir en la memoria o la informacin leda de la memoria (o de un perifrico) Lgica de control, circuitos que generan las seales de control (con reloj) Registro de instruccin (IR), memoriza temporalmente la instruccin del programa que la unidad de control est interpretando o ejecutando Contador del programa (PC), registro-contador que contiene en todo momento la direccin de memoria dnde se encuentra la instruccin siguiente a ejecutar.
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Unidad de tratamiento rD
RF RT F F Z S C V AR DR
Perifricos
IPv
r1 r0
SP IR PC
Lgica de control
ALU
OPv
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Unidad de control
......... 100A A73C 100B 7C4D 100C 65AD 100D BC73 100E 1000 100F 3A02 1010 7BC0 ...........
r1 r0
SP IR BC73 100E PC
Lgica de control
ALU
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5.3.2 Temporizacin
La ejecucin de cualquier instruccin se realiza en dos fases: Fase de captacin de instruccin. Siempre que se inicia una instruccin el procesador capta de la memoria la instruccin siguiente a ejecutar. AR PC DR M(AR) IR DR (En IR queda almacenado el codop de la instruccin) PC PC + 1
(suponemos que cada instruccin ocupa una sola posicin de memoria) Fase de ejecucin Se realizan las operaciones especficas correspondientes al cdigo de operacin (codop) de la instruccin captada, generndose las seales de control oportunas..
La ejecucin de una instruccin lleva consigo por lo menos un acceso a memoria (para captar la instruccin), pudiendo efectuar accesos adicionales (captacin de operandos, memorizacin de resultados, etc.)
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5.3.2 Temporizacin
AR PC DR M(AR) IR DR PC PC+1
...
codop1
codop2
codop3
codop4
codop5
...
codopn
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5.3.2 Temporizacin
Las operaciones: carga de un registro: MA, PC o IR MR, lectura de memoria: RM M(DM), incremento del contador de programa: PC PC+1, etc.) son las operaciones ms elementales que puede hacer el computador, y reciben el nombre de:
microoperaciones
Se puede concluir que una instruccin mquina, implica la realizacin de un conjunto determinado de microoperaciones en un orden preestablecido.
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5.3.2 Temporizacin
Ejemplo 5.1 direcciones Contenidos 0000 7AC4 Computador de palabras de 16 bits. En M(H0039) instruccin H0700: 0007 65C9 r7 M(rD) 0039 0700 rD contiene H54C2 003A 607D Contenidos de memoria: en la figura 003B 2D07 003C C000 Qu microoperaciones se realizarn durante la ejecucin de la instruccin, y 54C2 D7A2 los cambios que van teniendo lugar en PC, IR, AR, DR y r7. FFFF 3FC4
instrucciones
dato
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5.3.2 Temporizacin
direcciones 0000 0007 Contenidos 7AC4 65C9 0700 607D 2D07 C000 D7A2 3FC4
Contenidos de registros Fase Microperacin PC 0039 AR PC Captacin de nstruccin DR M(AR) IR DR PC PC+1 Ejecucin de nstruccin AR rD DR M(AR) r7 DR 0039 0039 IR AR DR R7
Valores iniciales
0039
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5.3.2 Temporizacin
AR PC DR M(AR) IR DR PC PC+1
carga AR rD DR M(AR) r7 DR
suma
salto
RT rD r0 r7+RT
...
PC rD
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Segn lo visto el procesador ejecuta secuencialmente las instrucciones del programa. Sin embargo, con las instrucciones de control se puede alterar el orden de ejecucin de un programa, saltando el mismo a la ejecucin de una instruccin ubicada en una direccin de memoria arbitraria, ds, especificada en la instruccin de salto.
Una vez ejecutada la instruccin de salto el programa ejecuta la instruccin contenida en la posicin ds y las que se encuentren sucesivamente a partir de ella
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En las instrucciones condicionales, el salto o llamada slo se produce si se cumple alguna o algunas condiciones, establecidas por el valor de alguno de los biestables indicadores (Z, S, P, V, etc.)
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. . CALL 10A3 . . . .
1
10A3 . 6FAB 6FAC . . 6FFF . . CALL 7CD9 . . . RET
2
7CD9 . AB35 AB36 . . AC55 . . CALL 003C . . . RET
3
003C . . . . 05AC . . . . . RET
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Pila PC PC ds
PC Pila
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En consecuencia, las microoperaciones a realizar durante la fase de ejecucin de las llamadas a procedimientos sern:
Llamada a procedimiento:
Pila PC PC ds
ds, es la direccin de comienza del procedimiento (contenido de rD, en el computador-ejemplo).
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Llamadas:
Zona libre para futuros anidamientos Zona LIFO (pila) Direccin retorno SP, cabecera de pila Direccin retorno Direccin retorno Direcciones de retorno apiladas
Retornos:
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AR PC DR M(AR) IR DR PC PC+1
carga AR rD DR M(AR) r7 DR
suma
salto
RT rD r0 r7+RT
...
PC rD
Fase de ejecucin
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5.3.4 MICROPROCESADORES
Los microprocesadores surgieron a partir de 1971, como consecuencia del alto grado de miniaturizacin de circuitos integrados logrado por la tecnologa electrnica. En la actualidad en un nico chip se integran millones de transistores. Los microprocesadores actuales, adems de los circuitos de un procesador clsico, suelen contener:
Procesador de coma flotante (FPU) Sistema o unidad de gestin de memoria (MMU) Memoria cach (se estudiar ms adelante, en esta
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5.3.4 MICROPROCESADORES
Un microcontrolador es un circuito integrado que contiene, total o parcialmente, los cinco elementos bsicos de una computadora completa (unidad de control, unidad de tratamiento, memoria y puertos de entrada/salida), estando proyectados para aplicaciones de supervisin, monitorizacin, gestin y control en sistemas tales como:
aparatos de telefona, Electrodomsticos (lavadoras, etc.), instrumentacin mdica, control de robots, lneas de ensamblado, control de semforos, etc.
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Ejemplos:
TMS1000 (de 4 bits de longitud de palabra), Intel 8051 (8 bits) dispone de 40 patillas de entrada/salida, una CPU de 12 MHz, memoria ROM de 4KB, y memoria RAM de 128 Bytes, y 32 lneas de E/S Intel 8096 (32 bits).
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5.3.4 MICROPROCESADORES
Los procesadores y controladores son circuitos que, por ser muy verstiles, pueden construirse en grandes series a muy bajo precio. Los procesadores se utilizan para
construir computadoras (microcomputadoras) al igual que los microcontroladores, embebidos en multitud de sistemas, de hecho la mayor parte de los sistemas electrnicos digitales actuales se construyen con microprocesadores o microcontroladores, por ser una opcin muy econmica.
Un sistema embebido es un sistema controlado por un microprocesador o un microcontrolador cuyo hardware y software estn especialmente diseados y optimizados para resolver una problema concreto. Por lo general, interactan continuamente con su entorno con objeto de monitorizar o controlar algn proceso
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5.3.4 MICROPROCESADORES
Hay sistemas embebidos en multitud de electrodomsticos (lavadoras de ropa, lavavajillas, hornos de microondas, etc.), equipos musicales y de vdeo (lectoras/graba-doras de casetes, CD, televisores, vdeos, mquinas de fotos, etc.), juguetes electrnicos (consola de videojuegos), sistemas de control industrial, Perifricos de computadores comunicaciones de datos (telfonos inalmbricos, telfonos mviles, mdem, etc.), equipos militares y armamento, etc. Un coche moderno puede contener del orden de 100 microprocesadores y microcontroladores que controlan: encendido, desplazamiento de la transmisin, control de potencia, antibloqueo del freno, control de traccin y seguridad (disparo de la bolsa de aire, etc.).
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http://atc.ugr.es/intro_info_mcgraw.html
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Una interrupcin (o excepcin o trap) es una detencin de la ejecucin de un programa antes de que concluya. Esta se realiza para ejecutar otro programa que gestiona o atiende la interrupcin, continundose despus con la ejecucin del programa interrumpido.
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Los orgenes de las interrupciones pueden ser muy diversos; por ejemplo:
Fallo de la alimentacin. Anomalas del hardware. Peticin de E/S de un perifrico. Desbordamiento en la ALU Utilizacin de una instruccin mquina inexistente Gestin de tiempo compartido (la interrupcin la provoca el reloj de tiempo real) Violacin de la proteccin de memoria. Peticiones del programador o usuario.
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Programa preferente
4 Fin de la interrupcin
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Puede observarse que la atencin de una interrupcin del tipo descrito es un caso muy particular de llamada a un procedimiento. En un computador las interrupciones se producen con una gran frecuencia. (Pueden producirse, por ejemplo, con intervalos de tiempo menores de 1 ms)
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Parmetros: capacidad, velocidad y precio Problema: Diferencia de velocidad de 1 2 rdenes de magnitud entre procesador y memoria.
Solucin: Memoria cach. Circuitos de tecnologa rpida (CMOS- esttica o ECL) que se sitan entre procesador y memoria
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Nivel
0 1 2 3 4 5 6 7 8
Dispositivo
Registros procesador Memoria cach (SRAM) Memoria principal (DRAM) Disco duro (magntico) Disco ptico CD-ROM Disco magnetoptico (WMRA) Disco ptico WORM Cinta magntica (DAT) Disquetes
Capacidad
< 1 KB 32 KB a 4 MB 1 MB a 1 GB 100MB200GB 680 MB 0,5 a 1 GB 650 MB 2.56 GB 2.88 MB
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Nivel 0
Registros de la CPU
Nivel 1
Cach ( SRAM )
Nivel 2
Nivel 3
Nivel 4
CAPACIDAD
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El procesador capta los datos e instrucciones de la cach, si no estn all, se produce una falta o fallo, y se buscan en la MP, y as sucesivamente, .... Se pasan bloques consecutivos de informacin a los niveles superiores de memoria, conforme se van necesitando. Principio de localidad espacial: Si se accede a una
posicin, hay mucha probabilidad de acceder a las cercanas Principio de localidad temporal: Si se accede a una posicin, tiende a ser referenciado de nuevo
CPU
P e rif ric o 0
P e rif ric o 1
B u s d e l s is te m a (a )
CPU
M e m o ria
P e rif ric o 0
P e rif ric o 1
B u s d e l s is te m a (b )
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Cache
Memoria Principal
Per. 00
Per.01 ....
Per.0n
Per. 10
Per.11 ....
Per.1n
Cache
Memoria Principal
Bus de E/S
Adaptador bus
(b)
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5.6 ESTRUCTURAS BSICAS DE COMPUTADORES (8). Controlador para Acceso Directo a Memoria (controlador DMA)
Per. 00
Per.01 ....
Per.0n
Per. 10
Per.11 ....
Per.1n
Cache
DMA
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Memoria principal
Controlador grfico
VRAM Acelerador
Controlador SCSI
Bus SCSI
Puente ISA
Bus ISA
Disco
DVD
Escner
Controlador disquete
Tarjeta de sonido
Modem
Controlador impresora
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Microoprocesador Chipset
Memoria ROM
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SIMM
conectores (oro)
DIMM
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CONECTOR PCI
CONECTOR PCI
CONECTOR PCI
CONECTOR PCI
CONECTOR ISA
12/1998. A.Prieto
CONECTOR ISA
VENTILADOR 2
CHIP SET
CONECTOR DE MEMORIA DI MM 2 CONECTOR DE MEMORIA DI MM 1 CONECTOR DE MEMORIA DI MM 0 IDE SECUNDARIO IDE PRIMARIO ALIMENTACIN PRIMARIA ALIMENTACIN 3.3 V
VENTILADOR 3
VENTILADOR 1
DISQUETERA 27 +
ALTAVOZ R ESET PWR LED
1 + + +
INFR ARR OJOS SUSP. PWR ON
HD LED
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68
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Paralelismo:
A nivel de instrucciones Segmentacin de cauce Arquitecturas superescalares A nivel de procesadores
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Arquitecturas de computadoras
SIMD
MIMD
Procesadore s matriciales
Procesadore s vectoriales
(multiprocesadores)
Memoria compartida
(multicomputadoras)
Paso de mensajes
UMA
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NUMA
MPP
Cluster s 74