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FLIP FLOPS
1.0 INTRODUO Os circuitos estados at o momento so chamados de circuitos combinacionais, pois os nveis lgicos de sada dependem apenas dos niveis lgicos de entrada, ambos para o mesmo instante de tempo. Qualquer condio de entrada anterior no tem nenhum efeito nas sadas atuais, pois um circuito combinacional no possui memria. A maioria dos circuitos digitais, possui circuitos combinacionais e elementos de memria.
1.0 INTRODUO Um dos elementos de memria mais importantes o Flip-flop, este implementado a partir de portas lgicas. Estas so organizadas de forma a permitir o armazenamento de informao.
Os estados de sada de um flip-flop so dois: SET ou RESET (CLEAR). Para a condio de SET temos: Q=1 e Q=0 Para a condio de RESET ou CLEAR temos: Q=0 e Q=1
2.0 LATCH OU FLIP-FLOP COM PORTAS NAND Podemos construir um flip-flop a partir de duas portas NAND conforme mostrado abaixo.
2.0 LATCH OU FLIP-FLOP COM PORTAS NAND Vejamos como SETAR o flip-flop.
2.0 LATCH OU FLIP-FLOP COM PORTAS NAND Vejamos como RESETAR o flip-flop.
2.0 LATCH OU FLIP-FLOP COM PORTAS NAND Vejamos como RESETAR e SETAR ao mesmo tempo.
Esta condio uma condio invlida, visto as sadas serem complementares entre si.
2.0 LATCH OU FLIP-FLOP COM PORTAS NAND Vejamos as transies na tabela abaixo.
SET 0 RESET 0 SADA INVLIDA
0
1 1
1
0 1
Q=1, Q=0
Q=1, Q=0 NO MUDA
S FF R
Determine a forma de onda para a sada Q de acordo com as entradas SET e CLEAR mostradas abaixo.
3.0 LATCH OU FLIP-FLOP COM PORTAS NOR Vejamos as condies de SET e RESET com as portas NOR.
SET 0 0 1
RESET 0 1 0
INVLIDA
4.0 FLIP-FLOP S-C COM CLOCK Este flip-flop entra em condio de funcionamento apenas quando recebe um pulso positivo na entrada CLOCK.
ENTRADAS S 0 1 C 0 0 CLOCK SADA Q NO MUDA 1
0
1
1
1
0
INVLIDA
4.0 FLIP-FLOP S-C COM CLOCK Vejamos as formas de onda abaixo e analisemos.
4.0 FLIP-FLOP S-C COM CLOCK Este flip-flop entra em condio de funcionamento apenas quando recebe um pulso negativo na entrada CLOCK.
ENTRADAS S C CLOCK SADA Q
0
1
0
0
NO MUDA
1
0
1
1
1
0
INVLIDA
Analisemos para: S=1 e C=0 Teremos Q=1 Para S=0 e C=1 Teremos Q=0
6.0 FLIP-FLOP J-K COM CLOCK Este flip-flop no apresenta entrada invlida quando ambas entradas esto em nvel alto, neste caso a sada Q comuta de estado.
ENTRADAS J K CLOCK SADA Q
0
1
0
0
NO MUDA
1
0
1
1
1
0
Q COMUTA
6.0 FLIP-FLOP J-K COM CLOCK Para o clock na borda negativa temos:
ENTRADAS S 0 1 0 C 0 0 1 CLOCK SADA Q NO MUDA 1 0
Q COMUTA
8.0 FLIP-FLOP D COM CLOCK Este flip-flop apresenta apenas uma entrada, ao contrrio dos flip-flops anteriores. Vejamos a representao abaixo.
D 0 CLK Q 0
PRESET
CLEAR
RESPOSTA DO FF
1
0
1
1
1
0
0
0
REGISTRADOR A U1 U2 U3
REGISTRADOR B U4 U5 U6
COMENTRIO ----------------------------------------
1
0
0
1
1
0
0
1
0
0
0
0
0
0
0
0
1
0
0
1
1
0
0
1
SEGUNDO PULSO
TERCEIRO PULSO
1 f1 f 0 2
f2
1 f1 2
FIM